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VHDL/Verilogなら俺にきけ

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0001デフォルトの名無しさん

2008/10/28(火) 21:35:37

VHDLで電卓を作ろうと思ってます。
１０進表示にしたいのですがどうしても
１６進にしかなりません。
誰か教えて教えてくれませんか??

0002デフォルトの名無しさん

2008/10/28(火) 21:40:49

スレタイと>>1の内容の乖離についてチンパンジーのアイちゃんに聴くスレに変わりました

0003デフォルトの名無しさん

2008/10/28(火) 21:49:40

①乖離←これを右クリでコピーする
②スタート→すべてのプログラム→アクセサリ→メモ帳を起動
③編集→貼り付け
④編集→すべて選択
⑤変換キーを押す

0004デフォルトの名無しさん

2008/10/28(火) 22:17:36

このスレッドは天才チンパンジー「アイちゃん」が
言語訓練のために立てたものです。

アイと研究員とのやり取りに利用するスレッドなので、
関係者以外は書きこまないで下さい。

0005デフォルトの名無しさん

2008/10/29(水) 05:38:04

>1
ttp://journal.mycom.co.jp/column/architecture/105/index.html

0006デフォルトの名無しさん

2008/10/29(水) 09:03:39

噴いた

0007デフォルトの名無しさん

2008/10/29(水) 11:50:27

スレタイに期待して来てみたら

0008デフォルトの名無しさん

2008/10/29(水) 12:10:13

>1
Verilog にすれば直ると思うよ。

0009デフォルトの名無しさん

2008/10/29(水) 12:45:19

7セグ使えばいいと思うよ>>1

0010デフォルトの名無しさん

2008/10/29(水) 12:47:31

こんなスレあったんだ
http://pc11.2ch.net/test/read.cgi/tech/1043858153/l50

0011デフォルトの名無しさん

2008/11/01(土) 13:09:55

--- 糸冬了 ---

0012デフォルトの名無しさん

2008/11/04(火) 01:31:40

良貨は悪貨を駆逐するという言葉が脳裏によぎる

0013デフォルトの名無しさん

2008/11/07(金) 19:39:27

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